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<project source="2.7.1" version="1.0">
This file is intended to be loaded by Logisim (http://www.cburch.com/logisim/).
<lib desc="#Wiring" name="0">
<tool name="Splitter">
<a name="appear" val="center"/>
</tool>
<tool name="Pin">
<a name="facing" val="north"/>
</tool>
<tool name="Probe">
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<a name="width" val="2"/>
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</tool>
<tool name="Pull Resistor">
<a name="facing" val="north"/>
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<tool name="Constant">
<a name="facing" val="north"/>
</tool>
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<lib desc="#Memory" name="4">
<tool name="ROM">
<a name="contents">addr/data: 8 8
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</a>
</tool>
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<lib desc="#I/O" name="5"/>
<lib desc="#Base" name="6">
<tool name="Text Tool">
<a name="text" val=""/>
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</tool>
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<lib desc="file#mem.circ" name="7"/>
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<tool lib="6" map="Button3" name="Menu Tool"/>
</mappings>
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<tool lib="6" name="Poke Tool"/>
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<tool lib="6" name="Text Tool">
<a name="text" val=""/>
<a name="font" val="SansSerif plain 12"/>
<a name="halign" val="center"/>
<a name="valign" val="base"/>
</tool>
<sep/>
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<a name="tristate" val="false"/>
</tool>
<tool lib="0" name="Pin">
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</toolbar>
<circuit name="main">
<a name="circuit" val="main"/>
<a name="clabel" val=""/>
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<a name="width" val="8"/>
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<a name="label" val="Data Mem Out"/>
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<a name="contents">addr/data: 8 32
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<comp lib="0" loc="(410,490)" name="Clock">
<a name="facing" val="north"/>
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<a name="bit1" val="0"/>
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